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Xeon Phi. 오른쪽은 Omni-Path 지원하지 않는 모델 인텔 재팬은 14일, HPC (High Performance Computing) 사업에 관한 기자를 위한 라운드 테이블을 실시했다. 올해 (2016년) 6월에 발표한 Xeon Phi를 중심으로 Intel의 기계학습 (머신러닝)에 관한 향후의 대처나 도입 메리트 등을 설명하는 내용이 되어, Intel 본사에서 HPC 사업에 종사하고 있는 휴고 살레 씨를 불러 개최되었다. 또, 이날 오후 13시 ~ 18시까지 도쿄 아키하바라의 아키하바라 UDX 세미나 실에서 "인텔 HPC 및 기계 학습 세미나"라는 세미나가 개최되고 있으며, 도쿄 대학 정보 기반 센터 장 나카무라 히로시 씨의 세션과 파트너 기업들의 강연 등이 진행되고 있다. 16GB의 내장 메..

Xeon Phi 기반 시스템 구축을 위한 레퍼런스 개발 Intel은 14nm 공정 세대의 새로운 멀티 코어 프로세서 "Knights Landing (KNL 나이츠 랜딩)"을 공식 발표했다. PCI Express 카드 기반의 코프로세서인 기존의 Xeon Phi (Knights Corner 나이츠 코너)와는 달리, Knights Landing은 자가 부트 가능한 메인 CPU의 버전이 투입 됐다. 또한 Knights Landing은 Intel이 개발한 HPC 패브릭 "Omni-Path"를 패키지에 통합한 버전이 제공된다. Intel 확장 시스템 프레임워크 (SSF : Scalable System Framework) Intel SSF 파트너 HPC 시스템의 구축을 용이하게 하는 Intel SSF Intel은 K..

긴 도움 닫기를 거쳐 마침내 정식 발표된 Knights Landing Intel은 매니코어 프로세서 "Xeon Phi"의 신제품 "Knights Landing (나이츠 랜딩 : KNL)"을 공식적으로 출시했다. 1칩에 최대 72를 코어를 탑재, 각 코어가 512-bit 폭의 벡터 유닛을 2기 갖춰, 32-bit 단 정밀도 부동 소수점 연산에서 6TFLOPS 이상 성능의 CPU이다. 발표의 장은 6월 후반에 독일에서 개최된 "ISC (International Supercomputing Conference) 2016". Intel은 Knights Landing 기술 개요를 지금까지 단계적으로 공개했으며, 일부 얼리 고객에게는 제품을 제공했다. 그러나 제품으로의 정식 발표나 다양한 고객을 위한 발매는 행하고 ..

슈퍼 컴퓨터 ISC 16을 첫선의 장으로 한 Intel Intel이 차세대 Xeon Phi 프로세서 "Knights Landing (나이츠 랜딩)"을 "정식"으로 발표했다. 1 칩에 최대 72 코어를 집적하고, 각 코어가 512-bit 폭의 벡터 유닛을 2기 갖추어 32-bit 단정밀도 부동 소수점 연산에서 6TFLOPS 이상, 64-bit 배정 밀도에서 3TFLOPS 이상을 낸다. 하이엔드 GPU에 필적하는 피크 성능의 차기 매니코어 프로세서이다. 제품 이름은 "Xeon Phi 7200" 패밀리가 된다. http://ark.intel.com/ko/products/series/94177/Intel-Xeon-Phi-Processor-7200-Series#@Server Knights Landing 패키지. ..

FUJITSU Server PRIMERGY CX600 M1 후지쯔 주식회사는 21일 기존 대비 약 2.5배의 성능을 제공하는 최신 Intel 제 CPU "Xeon Phi 프로세서 제품군"을 탑재한 고성능 컴퓨팅 (HPC) 분야용 x86 서버 "FUJITSU Server PRIMERGY CX600 M1 ( 이하, PRIMERGY CX600 M1)"을 9월부터 전 세계적으로 판매 개시한다고 발표했다. Xeon Phi 프로세서는, 기존 제품 "Xeon Phi 코 프로세서"의 후계가 되는 프로세서. 기존 제품은 Xeon 프로세서에 PCI Express를 통해 연결하고, 코 프로세서로 동작하지만, 신제품인 Xeon Phi 프로세서는 Xeon 프로세서와 마찬가지로 독립적으로 동작하는 CPU가된다. 1CPU 당 최대..

빅 데이터를 바꾼다! 제온 파이 탑재 서버의 가능성 최대 520 쓰레드를 1U 실현하는 빅 데이터 서버 전회 설명한 것은 "더 큰 용량, 더 빨리"요구 사항을 충족하는 데이터 센터의 중요성이다. (전회 설명이 이런 변화의 흐름에 대해서 약간 설명한거라.. 크게 뭔가?? 는 없습니다.) 스마트 장치와 소셜 미디어의 보급 클라우드에 데이터 집약화, 다양한 데이터를 비즈니스에 적극적으로 활용하는 빅 데이터의 부상 등 현재 일어나고 있는 모든 트렌드가 데이터 양의 폭발적인 증가를 유발하고 있다. 또한 데이터가 방대하게 되어 가는 것은 데이터 용량뿐만 아니라, 자연스래 처리 능력이 필요하다는 것이다. 즉, 앞으로의 데이터 센터는 지금까지에 비해 현격한 차이의 용량과 처리 능력을 가진 "하이퍼 스케일 확장성"이 필..

미국 Intel은 17 일 (독일 시간) Xeon Phi 시리즈에 코어 / 스레드 수를 증강한 고성능 버전 및 저가 버전의 새로운 폼 팩터를 채용한 새로운 라인업을 발표했다. 같은 날짜에 가격표도 추가되었다. Xeon Phi 시리즈는 Many Integrated Core (MIC) 아키텍처의 HPC 전용 보조 프로세서로 현재는 "Xeon Phi 5110P"가 시장에 투입되고 있다. 이번에 발표한 것은 저가 버전의 "Xeon Phi 3100 '시리즈 2모델과 고성능 버전인'Xeon Phi 7100 '시리즈 2모델. 또한 동 5100 시리즈에 새로운 폼팩터를 채용한 1 모델이 추가되어 총 5모델이 새롭게 출시된다. 모두 기존 모델과 마찬가지로 22nm 공정으로 제조되는 'Knights Corner "의 개발..

Knights Conner의 코드 네임으로 알려져왔다 Xeon Phi 코 프로세서 5110P의 다이 미국 Intel은 "Knights Conner"의 개발 코드 네임으로 개발 해왔던 HPC (High Performance Computing)를 위한 보조 프로세서 'Xeon Phi "(파이)를 2013년 1월 28일 (미국 시간) 일반용으로 발매를 시작하는 것을 밝혔다. 　HPC 시장은 GPGPU (G..

메모리 기술의 혁신이 이끄는 메모리 아키텍처의 단일화 Justin Rattner (저스틴 래트너) 씨 　Intel은 원래는 DRAM 제조 업체이며, 비 휘발성 메모리에 일시적으로 노력해 왔다. 그러나 반도체 메모리는 DRAM도 NAND 플래시도 큰 변혁기를 맞이하고 있다. 미세화의 한계에 도달 차세대 메모리 기술..

Intel 부사장 겸 IA 사업 본부 데이터 센터 사업부 사업 부장 커크 스코겐 씨 기간 : 4 월 12 일 ~ 13 일 (현지 시간) 개최 장소 : 중화인민 공화국 북경시 국가회의중심 Intel Developer Forum 2011 Beijing에서 4 월 13 일 2 일째의 기조 강연이 진행됐다. 이 기조 강연에는 Intel 부사장 겸 IA 사업 본부 데이터 센터 사업부 사업 부장 커크 스코겐 씨가 등장해 IA (Intel Architecture) 프로세서에 대한 방침 등을 설명했다. 스코겐씨는 "2012년의 플랫폼에 USB 3.0 기능을 통합한다"고 말하며, 2012년에 출시 되는 차세대 Core 프로세서용 플랫폼에서 USB 3.0 기능을 칩셋에 통합해 가는 방침을 공식적으로 처음 밝혔다. 또 In..

Intel 저스틴 래트너 부사장 겸 수석 연구원 IDF 이틀째인 9월 14일, Intel CTO (최고 기술 책임자) 저스틴 래트너 부사장 겸 수석 연구원에게 인터뷰 할 기회가 있었다. Intel의 연구 · 개발 부문을 총괄하는 래트너 CTO는 다음날 IDF 마지막 날 기조 연설을 행하는 바쁜 일정을 앞두고, 시간을 내어 주셨다. 일정 관계상 이번 기조 연설에 대한 질문을 하는 것은 할 수 없었다 (본고 집필 시점에서는 아직 기조 강연이 이루어지지 않은)때문에 예전부터 생각하고 있던 것을 몇 가지 물어 보았다. 먼저 물어보고 싶었던 것은, Intel R & D의 방향에 변화가 있을 것인가? 라는 것이다. 현재 Intel의 폴 오텔리니 CEO는 Intel의 역사상 최초의 박사 학위가 없는, 말하자면 비 기..

제 2세대 Larrabee 2는 아직 어중간한 채 Intel의 데이터 병렬 중시형인 매니코어 CPU "Larrabee (라라비)"의 상황이 부분적으로 보였다. 본래의 계획은 개별 칩으로의 Larrabee 계획은 다음과 같았다. 2010년에 Larrabee를 제품으로 출하, 그 후 약 1년이나 1년 조금 기간에 새로운 칩을 투입해 간다. 연이..

Larrabee 신명령의 정보만 공개 Intel은 게임 개발자 컨퍼런스 "GDC (Game Developers Conference)" 기술 세션에서 새로운 아키텍처의 높은 스루풋 매니코어 CPU "Larrabee (라라비)" 의 명령어 세트의 개요를 밝혔다. Larrabee는 16 ~ 24개 (2세대째)의 CPU 코어를 탑재한다 말하는 x86계 매니코어 CPU다. CPU 코어는 Pentium (P54C) 상당의 In-Order 실행 2 명령 발행 파이프 라인에서 각각의 CPU 코어에 16-wide 벡터 유닛을 탑재한다. CPU로서 프로그램 할 수 있지만, GPU와 같은 수준의 그래픽 처리도 할 수 있는, 즉, CPU와 GPU를 겸할 수 있는 점이 Larrabee의 큰 특징이다. GDC에서는 x86 명령 ..

Larrabee CPU 코어와 Pentium 코어 비교 Intel은 새로운 명령 "Larrabee NI (New Instructions)"의 첫 번째 구현인 CPU 아키텍처 "Larrabee (라라비)"는 심플한 IA-32 (x86) 계 CPU 코어를 기반으로 개발했다. 이미 알려진대로, Intel은 Larrabee CPU 코어를 Pentium (P5)을 출발점으로 개발했다고 한다. Intel이 SIGGRAPH, Intel Developer Forum (IDF), Hotchips 등에서 공개한 Larrabee 아키텍처 차트를 보면, Pentium을 베이스로 한 것을 잘알 수 있다. 아래 그림은 Larrabee CPU 코어를 Pentium과 비교한 차트이다. 그림에서 파란색 부분은 Pentium에서 유래한..

Intel의 명령 아키텍쳐 확장의 흐름에 있는 Larrabee 신 명령 Intel에 있어서 "Larrabee (라라비)"란 무엇인가? Larrabee가 throughput 컴퓨팅에 특화되어 벡터 연산과 멀티 쓰레드 성능에 초점을 맞춘 특수한 프로세서 제품인 것은 분명하다. 그러나 Larrabee의 새로운 명령 "Larrabee New Instructions (LNI)"자체는 더 범용적인 것이다. 아마 Intel의 메인스트림 CPU의 장기 명령 세트 로드맵 상에 위치한다. 그것 그대로 없더라도, 아마 Larrabee와 비슷한 명령 세트 확장이 PC & 서버 전용 CPU에도 구현 될 날이 올 것이다. (Knights Landing 과 Core i 시리즈에서 AVX 512로 통합) Intel은 장기 비전으로 ..