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슈퍼 컴퓨터 ISC 16을 첫선의 장으로 한 Intel Intel이 차세대 Xeon Phi 프로세서 "Knights Landing (나이츠 랜딩)"을 "정식"으로 발표했다. 1 칩에 최대 72 코어를 집적하고, 각 코어가 512-bit 폭의 벡터 유닛을 2기 갖추어 32-bit 단정밀도 부동 소수점 연산에서 6TFLOPS 이상, 64-bit 배정 밀도에서 3TFLOPS 이상을 낸다. 하이엔드 GPU에 필적하는 피크 성능의 차기 매니코어 프로세서이다. 제품 이름은 "Xeon Phi 7200" 패밀리가 된다. http://ark.intel.com/ko/products/series/94177/Intel-Xeon-Phi-Processor-7200-Series#@Server Knights Landing 패키지. ..

Intel이 FIVR (Fully Integrated Voltage Regulator)의 세부 사항을 공개 Intel은 "4세대 Intel Core 프로세서 (Haswell)"절전 기능의 열쇠인 통합 전압 레귤레이터 "FIVR (Fully Integrated Voltage Regulator)"의 개요를 점차 밝혔다. Haswell의 FIVR은 온다이 (On-Die)에 구현된 DC-DC 컨버터와 고밀도의 'MIM (metal-insulator-metal) 커패시터, 그것을 온 패키지 "패키지 트레이스 인덕터 (package trace inductor)"을 사용한다. FIVR 단위 중 인덕터 부분만 온다이가 아닌 패키지 측에있다. FIVR의 개요는 2014년 2 월의 반도체 기술 컨퍼런스 ISSCC (IEE..

빅 데이터를 바꾼다! 제온 파이 탑재 서버의 가능성 최대 520 쓰레드를 1U 실현하는 빅 데이터 서버 전회 설명한 것은 "더 큰 용량, 더 빨리"요구 사항을 충족하는 데이터 센터의 중요성이다. (전회 설명이 이런 변화의 흐름에 대해서 약간 설명한거라.. 크게 뭔가?? 는 없습니다.) 스마트 장치와 소셜 미디어의 보급 클라우드에 데이터 집약화, 다양한 데이터를 비즈니스에 적극적으로 활용하는 빅 데이터의 부상 등 현재 일어나고 있는 모든 트렌드가 데이터 양의 폭발적인 증가를 유발하고 있다. 또한 데이터가 방대하게 되어 가는 것은 데이터 용량뿐만 아니라, 자연스래 처리 능력이 필요하다는 것이다. 즉, 앞으로의 데이터 센터는 지금까지에 비해 현격한 차이의 용량과 처리 능력을 가진 "하이퍼 스케일 확장성"이 필..

2013년 6월 16일 (중앙 유럽 표준시), 독일의 작센 주 라이프 치히에서 슈퍼 컴퓨터에 관한 국제 회의 " International Supercomputing Conference 2013 "(이하 ISC13)가 개최되었다. 이 이벤트에 맞춰 세계적인 슈퍼 컴퓨터 성능 순위인 'TOP500 List'가 업데이트되어 Intel 아키텍처를 채용한 중국 방위 대학교의 슈퍼 컴퓨터 '톈허 2 "(Tianhe-2, 영명 Milky Way 2)가 세계에서 가장 빠른 슈퍼 컴퓨터의 영관을 획득했다. 자신의 제품을 채용한 슈퍼 컴퓨터가 세계 1위를 획득한 Intel은 조속히 보도 자료를 발표하여 HPC (High Performance Computing) 분야에서 Intel 아키텍처의 장점을 어필하고있다. 이번에 I..

IDF에서도 세션이 진행되는 Knights Corner 　Intel 개발자 컨퍼런스 "Intel Developer Forum (IDF) '가 11일 (현지 시간)부터 미국 샌프란시스코에서 시작된다. 프로세서 측면에서, 이번 IDF는 완전히 새로운 마이크로 아키텍처 "Haswell (하스웰)"에 대한 설명이 진행되는 등 화제가 많다. 그리고 Intel의 HPC (High Performance Computing)을 위한 매니 코어 "Xeon Phi (Knights Corner : 나이츠 코너)"에 대해서도 프로그래밍 세션이 다 설치되어 있다. 프로그래밍 측면에 미치는 Knights Corner 충격이 크기 때문에(Haswell도 트랜잭션 메모리가)에서 Knights도 IDF의 중요 항목의 하나가 되고 있다...

Larrabee에서 분할 다시 만들어진 Knights Corner Knights Corner의 발표를 행한 George Chrysos 씨 (Senior Principal Engineer, Intel) Intel은 고성능 컴퓨팅 (HPC)을 위한 매니 코어 아키텍처 "MIC (마이크 : Many Integrated Core)"를, "Intel Xeon Phi"브랜드로 투입한다. 그래픽 겸용이었던 Larrabee (라라비)에서 노선을 변경한 매니 코어 제품군이다. Larrabee에서 다시 결말을 내고 코드 네임은 "Knights (나이트) '제품군으로 전환했다. Larrabee 때와 마찬가지로 Xeon 계의 Intel CPU 및 PCI Express를 통해 연결한 이기종 구성으로 사용하는 것을 전제로 한 보..

Intel Larrabee 제품 계획을 다시 처음부터 Intel은 "Larrabee (라라비)"를 그래픽스 제품으로 투입하는 것을 포기했다. 왜? Intel은 Larrabee 제품 계획을 크게 바꿨다. 그래픽 용도는 45nm 공정의 Larrabee도 그리고 아마도 32nm 프로세스의 Larrabee 2로 불리고 있던 제품도 나오는 일은 없을 것 같다. HPC (High Performance Computing) 등 일부 고객은 Larrabee를 제공​​하지만, 볼륨이 나오는 그래픽용으로 발매를 Intel은 포기한 것 같다. 아키텍처를 변경한 Larrabee 3의 동향은 아직 보이지 않지만, 사실상 Larrabee 전략을 다시 처음부터라 말해도 좋다. 이 변화는 무엇을 의미하는 것인가. 무엇이 바뀌는지, 그..

Larrabee 신명령의 정보만 공개 Intel은 게임 개발자 컨퍼런스 "GDC (Game Developers Conference)" 기술 세션에서 새로운 아키텍처의 높은 스루풋 매니코어 CPU "Larrabee (라라비)" 의 명령어 세트의 개요를 밝혔다. Larrabee는 16 ~ 24개 (2세대째)의 CPU 코어를 탑재한다 말하는 x86계 매니코어 CPU다. CPU 코어는 Pentium (P54C) 상당의 In-Order 실행 2 명령 발행 파이프 라인에서 각각의 CPU 코어에 16-wide 벡터 유닛을 탑재한다. CPU로서 프로그램 할 수 있지만, GPU와 같은 수준의 그래픽 처리도 할 수 있는, 즉, CPU와 GPU를 겸할 수 있는 점이 Larrabee의 큰 특징이다. GDC에서는 x86 명령 ..

Larrabee CPU 코어와 Pentium 코어 비교 Intel은 새로운 명령 "Larrabee NI (New Instructions)"의 첫 번째 구현인 CPU 아키텍처 "Larrabee (라라비)"는 심플한 IA-32 (x86) 계 CPU 코어를 기반으로 개발했다. 이미 알려진대로, Intel은 Larrabee CPU 코어를 Pentium (P5)을 출발점으로 개발했다고 한다. Intel이 SIGGRAPH, Intel Developer Forum (IDF), Hotchips 등에서 공개한 Larrabee 아키텍처 차트를 보면, Pentium을 베이스로 한 것을 잘알 수 있다. 아래 그림은 Larrabee CPU 코어를 Pentium과 비교한 차트이다. 그림에서 파란색 부분은 Pentium에서 유래한..

Intel의 명령 아키텍쳐 확장의 흐름에 있는 Larrabee 신 명령 Intel에 있어서 "Larrabee (라라비)"란 무엇인가? Larrabee가 throughput 컴퓨팅에 특화되어 벡터 연산과 멀티 쓰레드 성능에 초점을 맞춘 특수한 프로세서 제품인 것은 분명하다. 그러나 Larrabee의 새로운 명령 "Larrabee New Instructions (LNI)"자체는 더 범용적인 것이다. 아마 Intel의 메인스트림 CPU의 장기 명령 세트 로드맵 상에 위치한다. 그것 그대로 없더라도, 아마 Larrabee와 비슷한 명령 세트 확장이 PC & 서버 전용 CPU에도 구현 될 날이 올 것이다. (Knights Landing 과 Core i 시리즈에서 AVX 512로 통합) Intel은 장기 비전으로 ..

게임 프로그래밍계의 거인, Tim Sweeney가 "미래의 게임 개발 기술"을 말한다 대규모 병렬 처리, 차세대 게임 그래픽 소프트웨어 렌더링으로 회귀 "CEDEC 2008"의 마지막 날, 해외 트랙 중심 세션이 개최 되었다. 강사는 미국 Epic Games의 CEO Tim Sweeney 씨. Sweeney 씨는 Epic Games의 설립자이자 1997 년에 출시 된 FPS "Unreal"의 메인 개발자이자 현재는 회사의 기술 이사를 겸임하고 연구 개발을 계속하고 있다는 현역 최첨단 기술자이다. "미래의 게임 개발 기술"이라는 제목의 이 강연에서는 Sweeney 씨가 예측하는 게임 개발의 미래상을 제시했다. Sweeney 씨는 평론가나 분석가가 아니라 그 미래상을 구현하는 최전선에 서있는 인물이다. 따라..

좁히는 Intel의 Larrabee에 대응을 서두르는 NVIDIA의 CUDA 전략 Intel은 데이터 병렬 + 태스크 병렬형 프로세서인 "Larrabee (라라비)"의 준비를 진행하고 있다. 올 여름 아키텍처의 개요를 분명히 하고 내년 (2009년)에는 제품 출시 예정이다. Intel은 당초 Larrabee를 고성능 컴퓨팅 (HPC)용으로 설명을 하고 있었지만, 실제로는 그래픽 제품에 투입한다. 이것은 NVIDIA가 그래픽 카드로 볼륨을 출하해 ​​범용 컴퓨팅에도 사용할 수 있는 프로세서를 보급시키는 전략을 답습하는 것이다. Intel은, 실은 Larrabee 전략의 처음부터 그래픽 제품으로 보급할 계획이었다. 즉, 그래픽 제품으로 전략을 전환한 것이 아니라 처음부터 그래픽으로 판매 계획이었다. 그러나 ..

배정밀도 부동 소수점 연산의 4개 포인트 NVIDIA는 CUDA와 G80 아키텍처는 고성능 컴퓨팅 (HPC)에서 어느 정도의 성공의 발판을 잡았다. 이렇게 한 NVIDIA에 있어서, 배정밀도 부동 소수점 연산 지원은 필수적인 요소이다. HPC 응용 프로그램은 배정밀도가 필요한 국면이기 때문이다. GPU 컴퓨팅을 위한 Tesla 제품에서는 배정밀도 연산은 열쇠가 된다고 해도 좋다. "지금까지도 배정밀도의 벽으로 이식할 수 없었던 응용 프로그램이 꽤 있었다"고 NVIDIA는 필요성을 강조한다. 문제는 현재의 실시간 그래픽에서는 단정밀도 (32-bit)까지의 부동 소수점 연산을 필요로 하는 것. 따라서 지금까지의 GPU는 단정밀도 연산 유닛 밖에 구현하지 않고, GPU에서 배정밀도 연산 지원에는 몇 가지 포인..

데이터 병렬로 향하는 Intel과 AMD와 NVIDIA가 격돌 Intel은 2008 ~ 9년에 투입하는 매니 코어 프로세서 "Larrabee (라라비)". Intel은 Larrabee에 의해 "하이 스루풋 컴퓨팅" 이라고 Intel이 부르는 데이터 병렬 애플리케이션 용 시장에 전용 프로세서로 진입한다. 그러나 이 시장을 노리는 것은 Intel 만이 아니다. AMD와 NVIDIA, 두 회사도 동일한 시장을 목표로 하고 있다. 오히려 GPU 코어를 사용한 "GPGPU (범용 GPU)"또는 "GPU 컴퓨팅"으로 선행한 것은 AMD와 NVIDIA이다. 흥미로운 것은 3사가 3사 모두 데이터 병렬 애플리케이션을 새로운 국경 생각, 거기에 주력하려고 하고 있는 점. 새로운 분야에서의 프로세서 전쟁이 이제 막 시작되..

장소 : 미국 San Francisco Moscone Center West 기간 : 9월 26일 ~ 28일 (현지 시간) Intel CTO 저스틴 래트너 씨 IDF 첫날은 폴 오텔리니 CEO 의한 오프닝 기조 강연에 이어 Intel CTO 저스틴 래트너가 R & D에 관한 기조 강연을 했다. "Over The Horizo​​n : THE MEGA-CENTER"라고 이름 붙인 강연에서는, 예상되는 데이터 센터 모습과 과제를 바탕으로 Intel이 개발중인 기술이 소개됐다. 메가 데이터 센터가 가진 과제와 해결로의 접근법 기조 강연의 제목인 MEGA-CENTER는 100만대 이상의 서버를 가진 데이터 센터인 것이다. 하루에 1억 이상의 비디오 시청이 행해지는 YouTube나 하루에 30억 페이지 뷰에 이르는 ..