[고전 2002년 4월 18일] PCI-SIG가 3GIO의 정식 명칭을 PCI Express 로 결정

 

WinHEC2002 보고​​서

 

3GIO의 이름이 공식적으로 PCI Express 로 결정

기간 : 4 월 16 ~ 18 일

장소 : Wasington State Convention & Trade Center

　PCI 규격을 개발하는 PCI-SIG는 WinHEC 2002의 세션에서 Intel이 규격을 책정하고 PCI-SIG에 제안 표준의 책정을 진행해 왔다 "3GIO (3rd Generation I / O)"의 명칭을 "PCI Express"로 한다고 발표했다. 또한 PCI Express에 대한 세션에서는 PCI Express에 대한 자세한 내용이 더욱 밝혀졌다.

3GIO의 정식 명칭은 PCI Express 결정

　지난해 9월에 개최된 Intel Developer Forum Conference Fall 2001에서는 3GIO의 이름으로 알려진 차세대 PCI 버스의 많은 스펙이 밝혀졌다. 이번 WinHEC 2002에서 그 정식 명칭이 더 세부 사항이 밝혀졌다. 정식 명칭은 "PCI Express"로 하이스피드, 포인트 투 포인트, PCI 버스와 소프트웨어 호환성 등을 보이고 있다고 한다.

　규격화의 일정은 올해 2월에 개최된 IDF Spring 2002에서 공개된 것으로 부터 변함없이 4월에 스펙 1.0의 초안이 PCI-SIG에 대해 제안된 60 일 리뷰가 진행된다. 또한 2분기 말에 공식 스펙 1.0이 공개 된다는 것이다.

 

PCI Express 로드맵. 2분기 중에 프로토콜 등이 결정되며

올해 하반기에 모바일 사양이 책정

　WinHEC의 PCI Express에 대한 세션에서는 좀 더 세세한 일정이 공개되었다.

　Intel의 3GIO 이니셔티브 관리자 마라 · 가단비 씨에 의하면 "1.0 에서는 프로토콜, 전기적, 소프트웨어 카드의 형상이 규정된다. 또한 올해 하반기에 PC 카드, 모바일의 사양 모듈의 형상 등의 사양 을 책정 할 것 "이라고 언급하면​​서"2006 년경에는 전기 신호의 사양을 확장하고 레인당 대역폭을 5 ~ 6Gbit/Sec (1 세대 3GIO는 2.5Gbit/Sec)로 끌어 올리고 2 세대의 PCI Express를 사용할 수 있도록 사양의 책정을 진행할 것 "이라고 설명하고, 2 세대 PCI Express는 레인 당 대역폭을 1세대 배까지 인상한다고 설명했다.


1X에서 500MB/Sec, 2X에서 1GB/Sec, 16X에서 8GB/Sec을 실현

　PCI Express는 기존의 PCI 버스가 32bit 병렬 버스이었던 비해 직렬로 되어있어 향후 CPU의 클럭이 올라 감에 따라 요구되는 주변 부분의 버스 대역폭의 향상이라는 요구 에 부응하기 위해 만들어진 차세대 버스이다.

 

PCI Express 대역폭을 설명

　병렬 버스의 클럭을 높여 나가는 방식을 통해 현재의 PCI 버스의 대역폭을 높여 나가는 것도 불가능 하지는 않지만, 병렬 버스에서는 올리는 클럭에 한계가 있고, 직렬로 전환하는 것으로, 더욱 클럭을 올려 가려는 접근이 취해지고 있다. 1세대 PCI Express는 레인 당 2.5Gbit/Sec는 대역폭이 실현되고있다. PCI Express는 8bit/10bit 인코딩이 행해지기 때문에 실제전송 바이트로 고치면, 레인 당 250MB/Sec의 대역폭이 실현된다. PCI Express는 위아래 양방향 레인을 제공하므로 표준 (PCI Express 1X)는 500MB/Sec의 대역폭이 실현된다. (8bit = 1Byte 이기 때문에 (b 와 B를 구분해야 합니다. b = bit, B = Byte 입니다.) 단순히 2.5GT/s = 312MByte/s가 나오지만, 8/10bit  인코딩은 전송의 80%가 실제 데이터 전송이기 때문에 2.5GT = 250MB 가 나옵니다. 312MB에 0.8을 곱해주던가.. 그냥 처음부터 2.5GT 를 10으로 나눠도 되죠. 각 레인당 상향 하향이 들어가 있기 때문에 총 대역폭은 2배.)

　PCI Express의 또 다른 특징은 레인의 폭을 확장 수정 할수 있는 것이다. 예를 들어 1X는 I / O 핀이 4핀으로 되어 있지만, 2X의 PCI Express는 I / O 핀이 배인 8 핀에 대역폭은 1GB/Sec이되는 것과 같이, 3X, 4X ......와 증가시켜 궁극적으로 16X (64 핀)까지 올려갈 수 있다. 16X는 8GB/Sec의 대역폭을 제공하게 된다. 2 세대 3GIO는 레인 당 대역폭이 5 ~ 6Gbit/Sec 이므로 1세대와 마찬가지로 8/10bit 인코딩이 행해졌다고하면 레인 당 500 ~ 600MB/Sec, 1X 모드에서 1 ~ 1.2 GB / Sec로 배 이상의 대역폭을 제공하게 된다. (아는 사람은 다 알겠지만.. 실제 2.0은 5GT로 정해집니다. 간단히 레인당 대역폭이 1.0의 2배로 증가 합니다.

 

3.0은 8GT 이지만... 인코딩 방식이 2.x 까지의 8/10bit 인코딩이 아닌(8/10bit 인코딩은 전체 전송에서 20%가 실제 데이터 전송과 관계가 없는 80% 의 효율이지만) 128/130bit 인코딩으로 바뀌기 때문에.. (실제 전송이 98.46...% 의 효율이 있음) 실제 정확히 2.0의 2배는 아니지만 2배라고 불러도 무방한 규격이 됩니다. 2.0 까지의 인코딩 방식으로 3.0의 8GT 로 전송한다면 1배속의 실제 대역폭은 2.0의 1.6배인 800MB가 되죠. 그러나 3.0에서 새로 도입된 128/130bit 인코딩으로 하면 984.6 MByte/s가 됩니다. 2.0의 500MB/s의 2배인 1GB/s는 정확히 아니지만, 거의 1GB/s에 가까우니 2배라고 불러도 무방하죠.

 

참고로 이전에 많이 쓰던 AGP 4배속은 약 1GB/s, 8배속은 약 2GB/s의 대역폭. AGP는 반이중 (half duplex)방식으로 단방향,양방향 속도가 동일.)

	핀 (데이터 전송 핀) 실제 슬롯이나 카드는 핀수가 더 많습니다. 전력,그라운드,기능,예약핀 등이 있기 때문에)	대역폭 (양방향. 단방향은 1/2)
1X	4핀 (상향 2핀, 하향 2핀)	500MB/Sec
2X	8핀 (상향 4핀,하향 4핀)	1GB/Sec
4X	16핀 (상향8핀,하향 8핀)	2GB/Sec
8X	32핀 (상향 16핀, 하향 16핀)	4GB/Sec
16X	64핀(상향 32핀,하향32핀)	8GB/Sec

 

PCI Express PC에 구현은 2004년 부터인가?

　IDF Spring 2002의 보고서 에서도 언급했듯이, Intel은 2003년 하반기에 서버용 칩셋에서 PCI Express를, PC 용 칩셋은 2004년 부터 지원 할 가능성이 높다. Intel은 고객에게 서버용 NIC는 2003년 후반에 PCI Express를 지원 클라이언트 용 NIC는 2004년에 지원하고 있으며, 2003년 2분기에 출시될 Prescott (Northwood의 차세대 코어) 용 칩셋 "Springdale "에서 PCI Express가 지원 될 예정이 없다는 것이 그 이유다.

　VIA Technologies와 SiS 같은 타사는 재빨리 올해 4분기에 PCI Express를 지원하는 OEM 업체 설명하고 있지만, 그것도 타사보다 빨리 기술에 있어 짜고 있다는 어필을 하기 위한 보여주기로 이 관계자는 많은 실제 보급은 아무리 빨라도 2003년 하반기 이후라는 것이 업계 관계자의 일치된 견해인 것 같다.

　단, Intel의 가단비 씨는 "PCI Express 비용은 현재의 PCI와 같거나 그 이하이다"라고 말했다. 그렇다면, OEM에게 갈아타지 않을 이유는 전혀없는 것으로 2003년 후반부터 2004년까지 한꺼번에 PCI Express 로의 교체가 진행하는 것이 가장 가능성이 높은 이야기라고 할 수 있겠다.

 

 

2002년 4월 18일 기사 입니다.

 

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